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설계중심의 디지털공학실험 실험 2 간단한 조합논리 회로설계 자료
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설계중심의 디지털공학실험 실험 2 간단한 조합논리 회로설계
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실험 2 간단한 조합논리 회로설계
2,1 이론적 배경
디지털시스템을 구성하는 논리회로는 크게 조홥논리회로와 순서논리회로로 구분.
조합논리회로 : 임의의 원하는 기능을 실행시키는 화로들을 기본게이트를 이용하여 조합. 현재의 출력이 이전의 입력에 관계없이 현재의 입력에 의해서만 결정되는 논리회로. 기억소자 갇지 않음
순서논리회로 : 현재의 출력이 현재의 입력뿐만 아니라 기억소자에 저장되어 있는 이전의 입력에 의해서도 결정되는 논리회로.
곱의 합(SOP) : 출력함수 값이 논리적으로 1이 되는 입력 변수의 행들을 AND 혹은 곱한 최소항들의 합하여 표한
합의 곱(POS) : 출력이 논리적으로 0이 되는 입력 변수의 행들을 OR 혹은 합ㅇ한 초대항 들을 곱하여 표현. 최대항은 출력함수가 0일때의 진리표에서의 행와 일치.
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